Verilog
¿Qué es Verilog?
Verilog es un lenguaje de descripción de hardware (HDL, en Inglés: Hardware Description Language), y su principal función es modelar sistemas digitales y electrónicos, y se basa en una jerarquía de módulos. En principio fue creado para ser un lenguaje de modelado de hardware por Phil Moorby en el año 1985, para Gateway Design Automation (adquirida más adelante por Cadence Design Systems, quien posee en la actualidad todos los derechos).
Tiene una sintaxis parecida al lenguaje C; pensado así para que sea ampliamente aceptado.
Actualmente, Verilog se utiliza en el diseño de hardware digital y es un dominante en la industria.
Soporta distintos niveles de abstracción en prueba e implementación de circuitos análogos, digitales o mixtos.
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